笨小孩
    蜗蜗，你好，问一下pm_runtime_last_busy_and_autosuspend(device)这个函数的功能是什么？一般在什么情况下执行呢？
    《Linux电源管理(11)_Runtime PM之功能描述》  发表时间：2016-11-02 17:50
    RaulXiong
    @linuxer：嗯，我上面说错了，是在q=&b之后。感谢博主的诸多回复。网上需要多一点像博主这样的精品文章！会继续关注。
    《perfbook memory barrier（14.2章节）中文翻译（下）》  发表时间：2016-11-02 10:41
    温柔海洋
    @linuxer：热切期待你这方面的文章，我们可以贡献出自己对内存管理和进程调度的理解。
    《Linux内核同步机制之（七）：RCU基础》  发表时间：2016-11-02 09:38
    linuxer
    @RaulXiong：是的，我写这份文档的时候，代码框里的文字是直接从原文的PDF中copy出来的，发表出来的时候，不知道怎么回事，删除了<>中的内容。不管怎么样，多谢你这么认真地读者。
    《perfbook memory barrier（14.2章节）中文翻译（下）》  发表时间：2016-11-01 23:11
    linuxer
    @RaulXiong：多谢！已经修改了。 还好有英文原文，不至于误导大家。哈哈
    《perfbook memory barrier（14.2章节）的中文翻译（上）》  发表时间：2016-11-01 23:01
    linuxer
    @RaulXiong：同意你的看法
    《perfbook memory barrier（14.2章节）的中文翻译（上）》  发表时间：2016-11-01 22:57
    linuxer
    @RaulXiong：本来呢我打算把RCU和memory barrier、memory order什么的搞的一清二楚，不过放弃了，这些东西比较绕，有时候会把自己绕晕了，我目前的计划是：先把内存管理和进程管理搞清楚，然后回头啃这些“硬骨头”。
    《Linux内核同步机制之（七）：RCU基础》  发表时间：2016-11-01 22:54
    linuxer
    @RaulXiong：回复温柔海洋，X86架构比较单纯，基本上的组件都是标准的，涉及DMA buffer访问的路径有两条： 1、CPU core<----前端总线--->北桥芯片<---->DDR memory。 2、设备（内嵌DMA控制器，有能力发起DMA操作）<------PCIe总线----->北桥芯片<---->DDR memory 由于北桥芯片有snoop的能力，因此，X86架构下，所有的memory访问都是coherent的。这也许就是你贴的代码注释中的“coherent architectures”的含义吧。 对于ARM架构，它不是那么玩的，ARM的策略是大家一起来玩，也就是博采众家之长。它采用license IP的方式，让更多的厂商加入ARM建立的生态系统。当然，这也就意味着架构的多样性。我们以你例子中的声卡驱动为例，在ARM arch下，其实系统拓扑有多种，例如声卡设备可以结在AMBA（APB）总线上（大部分的嵌入式设备应该这样），也可以接在PCIe总线上（然后通过AMBA bus接到CPU core上），即便是声卡设备和CPU core是通过AMBA连接，也许互联器件不支持coherence。因此，ARM是不是coherent architecture呢？我只能说是和具体的实现相关。随着ARM公司在服务器领域的耕耘，我猜ARM应该可以慢慢的象X86那么“高档”的，哈哈
    《Why Memory Barriers？中文翻译（上）》  发表时间：2016-11-01 22:49
    linuxer
    @RaulXiong：回复RaulXiong同学，同意你的说法，就算是有IOMMU，也不能保证cached DMA buffer是coherent的，重点应该是连接CPU core以及device的互联器件是否支持coherence，如果有这个能力，那么就能够snoop CPU cache。
    《Why Memory Barriers？中文翻译（上）》  发表时间：2016-11-01 22:26
    RaulXiong
    @crazy：你的具体问题是什么？我初步看了看那段代码，不是很难理解。
    《perfbook memory barrier（14.2章节）中文翻译（下）》  发表时间：2016-11-01 18:48

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