wowo
    @linuxer：呵呵，这种事儿我也急不来啊~~~
    《为什么会有“ARMv8A Architecture”这个分类》  发表时间：2014-12-08 13:10
    linuxer
    wowo同学，华为已经出了64 bit的ARM处理器，你们要加快啊
    《为什么会有“ARMv8A Architecture”这个分类》  发表时间：2014-12-08 12:33
    pingchangxin
    很赞成作总比不做好，谢谢你们的分享！
    《为什么会有“ARMv8A Architecture”这个分类》  发表时间：2014-12-08 09:59
    linuxer
    @tigger：这里我没有说明清楚，这里有两个precharge的词语，用在两个不同的场景中，一个是描述在进行cell的读操作的时候，使用了precharge讲BL的电压升到Vs/2。另外一个场景描述SDRAM controller发送PRECHARGE的命令，这个操作仅仅是操作WL，将一个行中的所有cell的M1三极管处于截止状态。 为了不引起歧义，我还是把第一个场景中的precharge修改一下吧
    《SDRAM Internals》  发表时间：2014-12-07 23:08
    linuxer
    @tigger：datasheet中的时序图非常多，我就没有贴上去，有空也可以补上
    《SDRAM Internals》  发表时间：2014-12-07 23:00
    linuxer
    @tigger：cpu deep sleep之后不会跑着iram中的code，因为这时候CPU已经不会取指令运行了。好的CPU应该在deep sleep之后应该shutdown包括CPU核心电压在内的大部分供电，仅仅保留一个非常小的SOC 上的一个HW block的供电，这个供电域应该包括RTC，2~3个GPIO，从deep sleep唤醒的逻辑电路，至少有一个scratch寄存器，保护了sleep那一点的PC值。 如果你想suspend to RAM的话，DDR的供电一定要保持。如果是suspend to disk的话，当然也可以shutdown DDR chip的供电。 当resume的时候，由于cpu core是完全下电的，因此cpu通用寄存器的内容全部都保持不住了（iram是否能保持住数据是和SOC系统的电源管理设计相关的），这时候，PC一般会等于0，也就是说从0地址开始取指令执行，具体0地址是什么也是和SOC设计相关，可能是ROM代码，也可能是NOR flash代码（也就是bootloader的代码了），但无论如何，最终是从scratch寄存器中恢复PC至，跳转到DDR ram中执行 ddr training和ddr bitflip我没有接触过，你可否给讲一讲？
    《SDRAM Internals》  发表时间：2014-12-07 22:59
    linuxer
    @tigger：CPU看不到cell，CPU只能看到线性地址。SDRAM controller把CPU的地址操作转换成行地址、列地址，bank地址。 CPU能访问的最小单位就是supercell。不过也不需要纠缠于supercell这个概念，这不是一个通用的概念。
    《SDRAM Internals》  发表时间：2014-12-07 22:44
    linuxer
    @tigger：WL和BL是真对一个cell描述时使用的术语。 当我们描述一个SDRAM芯片的时候，最小的寻址单位就是supercell，“8196行、1024列”都是针对一个supercell而言。 针对这个场景，1024列上的所有cell共享一个WL，选中某一行，就是设定WL为高电平，导通1024列上的所有cell的M1三极管，共计1024 X 16个cell。选中某一列，则选中了一个supercell，共计16个BL
    《SDRAM Internals》  发表时间：2014-12-07 22:41
    tigger
    Precharge 没看到能对row进行操作啊，为啥可以deactive呢？ACTIVE是选中一行，但是之前的描述PRRCHARGE是将BL电压设置到Vs/2。 不好意思，我没有先去查看网上的其他文章就直接提问了。按照常理我应该先学习再来发问的。
    《SDRAM Internals》  发表时间：2014-12-07 17:50
    tigger
    还有这个里面有很多时间点的缩写，但是好像没有具体的时序图啊？
    《SDRAM Internals》  发表时间：2014-12-07 17:39

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