linuxer
@tigger:CPU看不到cell,CPU只能看到线性地址。SDRAM controller把CPU的地址操作转换成行地址、列地址,bank地址。
CPU能访问的最小单位就是supercell。不过也不需要纠缠于supercell这个概念,这不是一个通用的概念。
《SDRAM Internals》 发表时间:2014-12-07 22:44
linuxer
@tigger:WL和BL是真对一个cell描述时使用的术语。
当我们描述一个SDRAM芯片的时候,最小的寻址单位就是supercell,“8196行、1024列”都是针对一个supercell而言。
针对这个场景,1024列上的所有cell共享一个WL,选中某一行,就是设定WL为高电平,导通1024列上的所有cell的M1三极管,共计1024 X 16个cell。选中某一列,则选中了一个supercell,共计16个BL
《SDRAM Internals》 发表时间:2014-12-07 22:41
tigger
Precharge 没看到能对row进行操作啊,为啥可以deactive呢?ACTIVE是选中一行,但是之前的描述PRRCHARGE是将BL电压设置到Vs/2。
不好意思,我没有先去查看网上的其他文章就直接提问了。按照常理我应该先学习再来发问的。
《SDRAM Internals》 发表时间:2014-12-07 17:50
tigger
还有一个问题,就是ddr bitflip这种现象一般是什么阶段出现呢?
当cpu 的额sleep之后,为了省电,这个时候ddr phy 应该是掉点吧。我想知道这个时候ddr的数据都丢失了吗?
据我的现有认识,cpu deep sleep之后的code应该会跑在iram,那么resume的时候一定是从iram跳到ddr,这个时候ddr应该要做一系列的操作保障ddr工作正常。比如ddr training 等等,不知道楼主对这一系列操作有没有了解啊?
《SDRAM Internals》 发表时间:2014-12-07 15:33
tigger
今天看了一点,一个bank的supercell矩阵是由8196行根1024列组成
看不太懂,这里一行 一列 应该不是对应WL BL吧?
《SDRAM Internals》 发表时间:2014-12-07 14:29
linuxer
@sourgrape:我觉得最重要的还是对技术执着的态度:如果你愿意把大部分的业余时间用来阅读内核代码,并且享受这个过程的话,你是不可能做不好这件事情的。
具体的建议包括:
1、学些c语言,理解编译、链接和加载的过程
2、学一些cpu体系结构的知识
3、结合linux kernel的代码,学习一些操作系统的知识
4、阅读各种硬件datasheet,并撰写代码驱动其工作
充分利用网络资源,不断的提升自己的能力
《Device Tree(一):背景介绍》 发表时间:2014-12-05 22:54
sourgrape
楼主,你好,我是一个刚开始接触linux驱动开发的,能否给我这个初学者一些建议。
谢谢~\(≧▽≦)/~啦啦啦
《Device Tree(一):背景介绍》 发表时间:2014-12-05 17:50
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