linuxer
    @CHENYAN:对于ARM64,VBAR_ELx寄存器保存中各个exception level的异常向量表的基地址,应该类似与X86的IDT寄存器。 你问题中的系统调用表是指什么?是指保存各个系统调用跳转函数的入口表格(sys_call_table)吗?这个表是软件定义,和硬件无关啊。
    ARM64的启动过程之(六):异常向量表的设定  发表时间:2016-09-27 19:12
    CHENYAN
    最近一直在研究ARM64 Linux的系统调用的HOOK方法. 记得以前X86平台下可以通过IDT寄存器获取系统调用表的基地址. 我看了ARM64的内核代码, 貌似没有类似的寄存器. 想问一下ARM64有办法获取系统调用表的基地址吗? 我对ARM64架构不是很熟悉, 能给点指导意见吗? 感谢!!! @wowo
    留言板  发表时间:2016-09-27 16:52
    CHENYAN
    看了你的文章深受启发,最近一直在研究ARM64 Linux的系统调用的HOOK方法.记得以前X86平台下可以通过IDT寄存器获取系统调用表的基地址.我看了ARM64的内核代码,貌似没有类似的寄存器.想问一下ARM64由办法获取系统调用表的基地址吗?感谢楼主
    ARM64的启动过程之(六):异常向量表的设定  发表时间:2016-09-27 16:45
    qkhhyga_2016
    Hi,wowo 想请问一下,如果cpu处于休眠状态,被外部中断唤醒后,是在何时跳到异常向量表的IRQ向量的?如果等CPUINIT 之后再跳转,那是否可认为中断控制器有pending的功能?谢谢!
    linuxer
    @linuxer:L1 cache既然已经写入,那么它一定应该在某个时刻去同步L2和main memory,对吗?那这是一个什么样的时刻,或者有什么操作可以主动发起这个同步吗? --------------------------- 基本上那个时刻是HW决定的。当L1 cache已经全部是valid的entry,当再次数据访问发生cache miss的时候,就需要从这些valid的entry中找出一个最近最少使用的那个entry把它踢出L1(具体算法是由硬件cache设计人员决定的),如果准备踢出的L1 entry是dirty的,那么就需要write back到L2 cache中。 ARM处理器提供了cache维护指令来进行clean cache的操作,具体可以参考ARM ARM
    anchen
    @linuxer:poc还是有点难懂。 https://community.arm.com/thread/8571 这里有些讨论,但是很难消化。 我其实有个疑问,L1 cache既然已经写入,那么它一定应该在某个时刻去同步L2和main memory,对吗?那这是一个什么样的时刻,或者有什么操作可以主动发起这个同步吗?
    anchen
    @linuxer:我的平台是dual core (Cortex A9)
    anchen
    @linuxer:真的很幸运!在这个平台上,获得这么清晰的建议(实在是楼主太强大了!)。 系统架构确实如你所述,CPU--->L1 cache--->L2 cache--->main memory。 我的经验不足,没能想到L1和L2的关系。 和你想法一样,我不打算invalidate L2 cache,这个不是最佳选择,也会引起效率的降低。关于poc或pou,我网上科普了下,能理解其概念。但具体怎么做? 如何在用户空间用代码去实现?我的应用都需要在用户空间去完成。 再次感谢,感谢楼主分享宝贵经验和知识!
    linuxer
    @linuxer:wowo,我是这么想的: 1、程序的数据访问路径是CPU--->L1 cache--->L2 cache--->main meory 2、DMAC的数据访问路径是DMAC--->L2 cache--->main meory 程序写入的时候,首先进入L1 cache,硬件决定什么时候从L1进入L2以及main memory(除非程序手动去clean cache),因此DMAC无法从L2中得到正确的数据。当然,上面都是针对write back 类型的cache说的。
    wowo
    @linuxer:为什么invalidate无效呢? 应用程序已经将微码更新到指定的memory中了,DMAC期望访问这个新的数据。 如果cache有效,则直接从cache中取出了旧的数据。 如果cache无效,DMAC将不得不从memory中从新读取数据(新的)。

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