linuxer
    @tigger:这里我没有说明清楚,这里有两个precharge的词语,用在两个不同的场景中,一个是描述在进行cell的读操作的时候,使用了precharge讲BL的电压升到Vs/2。另外一个场景描述SDRAM controller发送PRECHARGE的命令,这个操作仅仅是操作WL,将一个行中的所有cell的M1三极管处于截止状态。 为了不引起歧义,我还是把第一个场景中的precharge修改一下吧
    SDRAM Internals  发表时间:2014-12-07 23:08
    linuxer
    @tigger:datasheet中的时序图非常多,我就没有贴上去,有空也可以补上
    SDRAM Internals  发表时间:2014-12-07 23:00
    linuxer
    @tigger:cpu deep sleep之后不会跑着iram中的code,因为这时候CPU已经不会取指令运行了。好的CPU应该在deep sleep之后应该shutdown包括CPU核心电压在内的大部分供电,仅仅保留一个非常小的SOC 上的一个HW block的供电,这个供电域应该包括RTC,2~3个GPIO,从deep sleep唤醒的逻辑电路,至少有一个scratch寄存器,保护了sleep那一点的PC值。 如果你想suspend to RAM的话,DDR的供电一定要保持。如果是suspend to disk的话,当然也可以shutdown DDR chip的供电。 当resume的时候,由于cpu core是完全下电的,因此cpu通用寄存器的内容全部都保持不住了(iram是否能保持住数据是和SOC系统的电源管理设计相关的),这时候,PC一般会等于0,也就是说从0地址开始取指令执行,具体0地址是什么也是和SOC设计相关,可能是ROM代码,也可能是NOR flash代码(也就是bootloader的代码了),但无论如何,最终是从scratch寄存器中恢复PC至,跳转到DDR ram中执行 ddr training和ddr bitflip我没有接触过,你可否给讲一讲?
    SDRAM Internals  发表时间:2014-12-07 22:59
    linuxer
    @tigger:CPU看不到cell,CPU只能看到线性地址。SDRAM controller把CPU的地址操作转换成行地址、列地址,bank地址。 CPU能访问的最小单位就是supercell。不过也不需要纠缠于supercell这个概念,这不是一个通用的概念。
    SDRAM Internals  发表时间:2014-12-07 22:44
    linuxer
    @tigger:WL和BL是真对一个cell描述时使用的术语。 当我们描述一个SDRAM芯片的时候,最小的寻址单位就是supercell,“8196行、1024列”都是针对一个supercell而言。 针对这个场景,1024列上的所有cell共享一个WL,选中某一行,就是设定WL为高电平,导通1024列上的所有cell的M1三极管,共计1024 X 16个cell。选中某一列,则选中了一个supercell,共计16个BL
    SDRAM Internals  发表时间:2014-12-07 22:41
    tigger
    Precharge 没看到能对row进行操作啊,为啥可以deactive呢?ACTIVE是选中一行,但是之前的描述PRRCHARGE是将BL电压设置到Vs/2。 不好意思,我没有先去查看网上的其他文章就直接提问了。按照常理我应该先学习再来发问的。
    SDRAM Internals  发表时间:2014-12-07 17:50
    tigger
    还有这个里面有很多时间点的缩写,但是好像没有具体的时序图啊?
    SDRAM Internals  发表时间:2014-12-07 17:39
    tigger
    还有一个问题,就是ddr bitflip这种现象一般是什么阶段出现呢? 当cpu 的额sleep之后,为了省电,这个时候ddr phy 应该是掉点吧。我想知道这个时候ddr的数据都丢失了吗? 据我的现有认识,cpu deep sleep之后的code应该会跑在iram,那么resume的时候一定是从iram跳到ddr,这个时候ddr应该要做一系列的操作保障ddr工作正常。比如ddr training 等等,不知道楼主对这一系列操作有没有了解啊?
    SDRAM Internals  发表时间:2014-12-07 15:33
    tigger
    @tigger:或者说 从cpu的角度应该看不到cell吧,他能访问到的最小的单位是supecell吗?
    SDRAM Internals  发表时间:2014-12-07 15:19
    tigger
    今天看了一点,一个bank的supercell矩阵是由8196行根1024列组成 看不太懂,这里一行 一列 应该不是对应WL BL吧?
    SDRAM Internals  发表时间:2014-12-07 14:29

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